AMD Ryzen处理器:amd3000系列多久上市?amd reyzn3000怎么样

2019-03-21 11:03

导读: 对于处理器这一块,你有什么样的想法,想不想了解一下呢?不如来看一下 AMD Zen/Zen+ 微架构处理器,有什么样的功能吧。 AMD Zen/Zen+ 微架构处理器,为了减少资料越过不同频率域的延迟影响,将Infinity Fabric 和记忆体控制器运作时脉与外部记忆体时脉挂勾

对于处理器这一块,你有什么样的想法,想不想了解一下呢?不如来看一下AMD Zen/Zen+ 微架构处理器,有什么样的功能吧。

AMD Zen/Zen+ 微架构处理器,为了减少资料越过不同频率域的延迟影响,将Infinity Fabric 和记忆体控制器运作时脉与外部记忆体时脉挂勾,实则为记忆体等效时脉的一半,如今主机板厂开始收到新版AGESA 预备支援未来上市产品,内部多了一些有趣设定。

AMD 桌上型Ryzen 3000 系列处理器,有很大的可能性将于今年Computex 展期发表,上市时间紧追在后,近期主机板厂多已收到新版AGESA 0.0.7.2,内部多出一些设定,预计用以支援未来的处理器产品。譬如桌上型 Ryzen 3000 处理器将以运算核心晶粒和 I/O 核心晶粒组合而成,以八核心为 1 个运算晶粒如今称之为 Compute Die(CCD)。

Reddit 网站已有网友针对Biostar 所释出的UEFI 更新档进行分析,CCD 核心数量控制有着(1+1)、(2+0)、(3+0)、(2+2)、(4+2 )、(3+3)等选项,若以AM4 封装版本塞入2 个CCD chiplet 而言,最高可以推出16 核心32 执行绪的产品,最低则是12 核心24 执行绪。

另一个更为有趣的地方,则藏在XFR Enhancement 选项当中,除了能够设定FCLK(Infinity Fabric 的运作时脉)与MEMCLK(外部记忆体时脉),UCLK(记忆体控制器时脉)新增1 :1 除频选项。在Zen/Zen2 微架构当中,FCLK 和UCLK 与MEMCLK 挂勾,实作上是以DDR4 等效时脉一半2:1 方式运作,也就是当使用者插上DDR4-2666 记忆体,FCLK 和UCLK 即以1333MHz 时脉运作。

▲Reddit 已有网友分析 Biostar 所释出含有 AGESA 0.0.7.2 的 UEFI 更新档,UCLK 将提供 MEMCLK 1:1 或是 2:1 选项。

新版AGESA 0.0.7.2 于XFR Enhancement 选项多出UCLK==MEMCLK 和UCLK==MEMCLK/2 等2 种选项,表示采用Zen 2 微架构的桌上型Ryzen 3000 系列处理器记忆体控制器,除了拥有与现行Zen/Zen+ 相同的2:1 除频比例,再多出与DDR4 等效时脉相同的频率运作的选项,预计可以增加记忆体存取表现。

另一方面,若是记忆体控制器不在CCD chiplet 身上,而是整合到I/O 核心内部,那么处理器核心存取记忆体则多出CAKE(Coherent AMD socKet Extender)-IFOP(Infinity Fabric On-Package )-IFOP-CAKE 这段路径,反之亦然,该如何解决增加的延迟时间也是个问题。当然,以上只是根据现有资料推测,详情最终还是要等到 Computex 才会明朗。

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